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      電子發燒友網>電子資料下載>電源技術>基于FPGA仿真結果的MPEG4可變長數據解碼器設計詳細概述

      基于FPGA仿真結果的MPEG4可變長數據解碼器設計詳細概述

      2018-04-23 | rar | 0.46 MB | 次下載 | 免費

      資料介紹

      　　本文討論了一種高吞吐量流水方式構建的MPEG-4可變長解碼器的設計與仿真結果。在這種解碼器中，我們采用了基于PLA的并行解碼算法，這種算法能夠實現每個時鐘解碼一個碼字。同時，為了提高解碼的效率，降低操作的延遲，我們在設計中還引入了流水線操作方式、碼表分割等技術，這些技術有利于并行操作的實現。在文章的最后一部分，我們給出了FPGA的仿真結果，結果顯示這種結構的解碼器完全能夠滿足MPEG-4的可變長數據的解碼需求。

      基于FPGA仿真結果的MPEG4可變長數據解碼器設計詳細概述

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