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      電子發燒友網>電子資料下載>嵌入式開發>嵌入式五級流水線CPU核的設計與實現

      嵌入式五級流水線CPU核的設計與實現

      2010-07-26 | rar | 256 | 次下載 | 5積分

      資料介紹

      ?本文基于FPGA平臺設計并實現了一種嵌入式16位RISC CPU核。以MIPS CPU指令集為參考,完成指令集設計;對指令處理過程進行抽象,把指令分成取指、譯碼、執行、訪存、寫回五級流水處理,根據處理過程所需要的元件構建五級數據通路;針對流水線處理產生的數據相關構建旁路通路;根據五級數據通路及旁路通路所需要的協調信號構建控制通路;把數據通路和控制通路融合成CPU核。采用VHDL實現CPU核;在CPU核上運行測試程序,并給出仿真結果;在FPGA平臺上對CPU核進行驗證。結果表明了所設計CPU核的有效性。
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