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4 位雙向移位寄存器（并行存取） 54194/74194
54S194/74S194
54LS194/74LS194
194 為 4 位雙向移位寄存器，共有 54194/74194、
54S194/74S194，54LS194/74LS194 三種線路結構形式。
其主要電特性的典型值如下：
型號 fm PD
54194/74194 36MHz 195mW
54S194/74S194 105MHz 425mW
54LS194/74LS194 36MHz 75mW
當清除端（CLEAR）為低電平時，輸出端（QA－QD）
均為低電平。
當工作方式控制端（S0、S1）均為高電平時，在時鐘
（CLOCK）上升沿作用下，并行數據（A－D）被送入
相應的輸出端QA－QD。此時串行數據（DSR、DSL）被禁
止。
當S0 為高電平、S1 為低電平時，在CLOCK上升沿作
用下進行右移操作，數據由DSR送入。
當S0 為低電平、S1 為高電平時，在CLOCK上升沿作
用下進行操作，數據由DSR送入。
當 S0 和 S1 均為低電平時，CLOCK 被禁止。對于 54
（74）194，只有當 CLOCK 為高電平時 S0 和 S1 才可改
變。
邏輯符號：
引出端符號
CLOCK 時鐘輸入端
CLEAR 清除端（低電平有效）
A－D 并行數據輸入端
DSL 左移串行數據輸入端
DSR 右移串行數據輸入端
S0、S1 工作方式控制端
QA－QD 輸出端
極限值
電源電壓 7V
輸入電壓
54/74194，54/74S194 5.5V
54/74LS194 7V
工作環境溫度
54××× -55～125℃
74××× -0～70℃
儲存溫度 -65℃～150℃
54S194/74S194
54LS194/74LS194
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54S194/74S194，54LS194/74LS194 三種線路結構形式。
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型號 fm PD
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當清除端（CLEAR）為低電平時，輸出端（QA－QD）
均為低電平。
當工作方式控制端（S0、S1）均為高電平時，在時鐘
（CLOCK）上升沿作用下，并行數據（A－D）被送入
相應的輸出端QA－QD。此時串行數據（DSR、DSL）被禁
止。
當S0 為高電平、S1 為低電平時，在CLOCK上升沿作
用下進行右移操作，數據由DSR送入。
當S0 為低電平、S1 為高電平時，在CLOCK上升沿作
用下進行操作，數據由DSR送入。
當 S0 和 S1 均為低電平時，CLOCK 被禁止。對于 54
（74）194，只有當 CLOCK 為高電平時 S0 和 S1 才可改
變。
邏輯符號：
引出端符號
CLOCK 時鐘輸入端
CLEAR 清除端（低電平有效）
A－D 并行數據輸入端
DSL 左移串行數據輸入端
DSR 右移串行數據輸入端
S0、S1 工作方式控制端
QA－QD 輸出端
極限值
電源電壓 7V
輸入電壓
54/74194，54/74S194 5.5V
54/74LS194 7V
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