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      電子發燒友網>電子資料下載>電子元器件應用>SoC的PLL設計要求方案

      SoC的PLL設計要求方案

      2017-09-07 | rar | 0.36 MB | 次下載 | 免費

      資料介紹

      　　PLL（鎖相環）是SoC（系統單芯片）中常見的模擬電路。幾乎所有時鐘速率高于30MHz的SoC都會用一只PLL作頻率合成。不過，世上并不存在一種“萬能”的PLL。各種器件都有其頻率、功率、面積、性能和功能范圍。

      　　下圖是電荷泵PLL有對輸入信號的低通功能，對相位噪聲的高通功能。

      SoC的PLL設計要求方案

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