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      電子發燒友網>電子資料下載>電子資料>時序至關重要：改善分數分頻鎖相環合成器中的整數邊界雜散狀況

      時序至關重要：改善分數分頻鎖相環合成器中的整數邊界雜散狀況

      2022-11-04 | pdf | 155.79KB | 次下載 | 2積分

      資料介紹

      例如，若是鑒相器頻率為100MHz，輸出頻率為2001MHz，那么整數邊界雜散將為1MHz的偏移量。在這種情況下，1MHz還是可以容忍的。但當偏移量變得過小，卻仍為非零值時，分數雜散情況會更加嚴重。 ? 采用可編程輸入倍頻法來減少整數邊界雜散 ? 可編程倍頻器的理念是讓鑒相器頻率發生位移，這樣壓控振蕩器（VCO）頻率就能遠離整數邊界?？紤]一下用20MHz的輸入頻率生成540.01MHz的輸出頻率，如圖1所示。該器件具有一個輸出分頻器（在VCO之后），但輸出頻率和VCO頻率都接近20MHz的整數倍。這種設置將迫使任何PLL產生分數雜散。 …
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