資料介紹
Vitis? AI 開(kāi)發(fā)環(huán)境加速了 Xilinx? 硬件平臺(tái)上的 AI 推理,包括邊緣設(shè)備和 Alveo? 加速器卡。它由優(yōu)化的 IP 核、工具、庫(kù)、模型和示例設(shè)計(jì)。它在設(shè)計(jì)時(shí)考慮了高效率和易用性在賽靈思 FPGA 和自適應(yīng)計(jì)算上釋放 AI 加速的全部潛力加速平臺(tái) (ACAP)。它使沒(méi)有 FPGA 知識(shí)的用戶(hù)更容易開(kāi)發(fā)深度學(xué)習(xí)推理應(yīng)用,通過(guò)抽象底層 FPGA 的復(fù)雜性和阿卡普。
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