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簡介：在FPGA片內實現全數字鎖相環用途極廣。本文在集成數字鎖相環74297的基礎上進行改進，設計了鎖相 狀態檢測電路，配合CPU對環路濾波參數進行動態智能配置，從而使鎖相環快速進入鎖定狀態，在最短時間內 正常工作并且提高輸出頻率的質量。 關鍵詞： 全數字鎖相環 數字環路濾波器 數字單穩態振蕩器 1 引言 數字鎖相環路已在數字通信、無線電電子學及電力系統自動化等領域中得到了極為廣泛的應用。隨著集成電路 技術的發展，不僅能夠制成頻率較高的單片集成鎖相環路，而且可以把整個系統集成到一個芯片上去。在基于 FPGA的通信電路中，可以把全數字鎖相環路作為一個功能模塊嵌入FPGA中，構成片內鎖相環。 鎖相環是一個相位誤差控制系統。它比較輸入信號和振蕩器輸出信號之間的相位差，從而產生誤差控制信號來 調整振蕩器的頻率，以達到與輸入信號同頻同相。所謂全數字鎖相環路(DPLL)就是環路部件全部數字化，采用 數字鑒相器（DPD）、數字環路濾波器(DLF)、數控振蕩器(DCO)構成的鎖相環路，其組成框圖見圖1示。 當鎖相環中的鑒相器與數控振蕩器選定后，鎖相環的性能很大程度依賴于數字環路濾波器的參數設置。 2 K計數器的參數設置 74297中的環路濾波器采用了K計數器。其功能就是對相位誤差序列計數即濾波，并輸出相應的進位脈沖或是借 位脈沖，來調整I/D數控振蕩器輸出信號的相位（或頻率），從而實現相位控制和鎖定。 K計數器中K值的選取需要由四根控制……
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