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噪聲對高性能模擬電路設計人員來說是一個極其重要的參數(shù)。對高速時鐘、模數(shù)轉(zhuǎn)換器 (ADC)、數(shù)模轉(zhuǎn)換器 (DAC)、電壓控制振蕩器(VCO)和鎖相環(huán)(PLL)來說尤其如此。降低輸出電壓噪聲的關鍵是保持交流閉環(huán)增益接近單位增益，且不影響交流性能和直流閉環(huán)增益。
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