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      電子發燒友網>電子資料下載>仿真技術>信號完整性和時序分析的模式變化

      信號完整性和時序分析的模式變化

      2010-04-27 | rar | 233 | 次下載 | 10積分

      資料介紹

      信號完整性和時序分析的模式變化:簡單的接口分析經驗法則在分析現代高速接口（如DDR2、PCI Express和SATA-II）時非常不合適。隨著新興標準（如DDR3 和5-10 Gbps串行接口）逐漸普及，這個問題將更加嚴重。

      如果僅對設計中最短和最長的網絡進行信號完整性分析，就不可能鑒別出由于較短連線的長度、過孔數、路由層、AC指標、封裝寄生和電源分配等參數的變化而造成的最壞碼間干擾、串擾或接腳時序情況。若要更準確地預測系統級噪聲和時序余量，就需要采用以接口為中心、包括信號完整性、時序、串擾和電源完整性分析在內的全面的分析方法。

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