資料介紹
在現代無線接收器設計中,高采樣率的模數轉換器(ADC) 通常被用作中頻復合調制信號的采樣。基于CMOS開關電容的ADC因其低成本和低功耗而成為這類設計的首選。這類ADC的前端為非緩沖型,直接耦合至采樣網絡,所以 ADC的輸入阻抗會隨時間(跟蹤和保持模式切換時)變化,這就對驅動ADC的放大器提出了挑戰。為了在驅動ADC的同時獲得極小的噪聲和信號失真,有必要設計一種無源網絡接口,實現寬帶噪聲抑制和采樣保持阻抗的變換,從而為驅動放大器提供一個更匹配的負載阻抗。本文將介紹如何在多個常用IF頻率下采用諧振法將采樣保持阻抗變換為可預測性的負載,從而更精確地設計抗混疊濾波器。
為了降低功耗,開關電容ADC省掉了ADC前端中的緩沖。 ADC采樣保持放大器電路(SHA)由輸入開關、輸入采樣電容、采樣開關和放大器構成,如圖1所示,輸入開關直接連接著驅動器和采樣電容。輸入開關閉合時(跟蹤模式),驅動電路給輸入電容充電。輸入開關斷開時(保持模式),驅動電路與輸入電容分離。該ADC的跟蹤模式和保持模式的時間大致相等。
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