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提出一種H.264去塊濾波系統(tǒng)的優(yōu)化設計方法。通過合理設計流水線級數(shù)提高并行性，適當增加內(nèi)部SRAM來提高系統(tǒng)速度和總線利用率，使用一種層次化的有限狀態(tài)機設計方法，實現(xiàn)對數(shù)據(jù)流的精確控制并且有效降低硬件實現(xiàn)復雜度?；?a target='_blank' class='arckwlink_none'>FPGA的驗證結(jié)果顯示在最壞情況下濾波每個宏塊平均只需220個時鐘，比原有方案快10個時鐘以上。
關鍵詞：H.264標準；去塊濾波；有限狀態(tài)機；現(xiàn)場可編程邏輯器件(FPGA)
關鍵詞：H.264標準；去塊濾波；有限狀態(tài)機；現(xiàn)場可編程邏輯器件(FPGA)
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