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      電子發燒友網>電子資料下載>測試測量>用PLL 時鐘和TestKompress 實現at-spee

      用PLL 時鐘和TestKompress 實現at-spee

      2010-06-18 | rar | 140 | 次下載 | 5積分

      資料介紹

      At-speed 測試作為新的測試方法，必然會對與測試相關的各方面，如測試設
      備、可測性設計等，有更高的要求。首先，要進行at-speed 測試必須有at-speed
      的測試時鐘。At-speed 測試時鐘的頻率功能模式下的時鐘頻率相當，比傳統
      stuck-at 測試的時鐘要快很多。At-speed 時鐘既可以由測試設備產生，直接通過
      管腳輸入芯片，也可以由片內的邏輯產生。如果at-speed 測試時鐘由測試設備產
      生，要求測試設備能夠產生高頻率的時鐘，這就意味著可能需要的測試設備的升
      級，即相應的測試成本增加。為了降低測試成本，我們在芯片設計階段做相應的
      可測性設計，由片內的邏輯（PLL control）產生at-speed 測試時鐘，本文將在后
      面詳細討論這一方法。
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