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      標(biāo)簽　>　fpga設(shè)計(jì)

      fpga設(shè)計(jì)

      fpga設(shè)計(jì)

      +關(guān)注9人關(guān)注

      FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

      文章：348個(gè) 瀏覽：26489次 帖子：90個(gè)

      fpga設(shè)計(jì)技術(shù)

      FPGA設(shè)計(jì)面臨的挑戰(zhàn)和解決方案

      設(shè)計(jì)可靠的可編程邏輯門陣列（FPGA）對(duì)于不容故障的系統(tǒng)來說是一項(xiàng)具有挑戰(zhàn)性的任務(wù)。本文介紹FPGA設(shè)計(jì)的復(fù)雜性，重點(diǎn)關(guān)注如何在提高可靠性的同時(shí)管理隨之...

      2024-08-06 標(biāo)簽：FPGAFPGA設(shè)計(jì)可編程邏輯門陣列 399 0

      基于FPGA的AES256光纖加密設(shè)計(jì)案例實(shí)現(xiàn)

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      近年來，信息安全應(yīng)用于生活中的各個(gè)領(lǐng)域.在光通信系統(tǒng)中，往往對(duì)速率有著較高的追求。其中對(duì)光模塊，光纖通信中的傳輸算法，傳輸?shù)哪Ｊ揭约肮獠ǘ芜x取有密切關(guān)聯(lián)。

      2024-05-10 標(biāo)簽：FPGA收發(fā)器FPGA設(shè)計(jì) 1663 0

      使用Altera Interface Planner高效設(shè)計(jì)FPGA引腳布局

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      Altera Interface Planner 用于探索設(shè)備的外設(shè)架構(gòu)，并高效地分配接口。通過實(shí)時(shí)進(jìn)行擬合和合法性檢查，防止非法引腳分配。

      2024-03-22 標(biāo)簽：pcbFPGA設(shè)計(jì)Altera 2418 0

      FPGA設(shè)計(jì)的IP和算法應(yīng)用綜述

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      IP(Intelligent Property) 核是具有知識(shí)產(chǎn)權(quán)核的集成電路芯核總稱，是經(jīng)過反復(fù)驗(yàn)證過的、具有特定功能的宏模塊，與芯片制造工藝無關(guān)，可...

      2024-03-07 標(biāo)簽：FPGA設(shè)計(jì)寄存器EDA工具 1153 0

      請(qǐng)問create_generated_clock該怎么使用呢？

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      FPGA設(shè)計(jì)中，生成時(shí)鐘分為兩大類：自動(dòng)生成時(shí)鐘和用戶生成時(shí)鐘。

      2024-01-25 標(biāo)簽：FPGA設(shè)計(jì)PLL電路 1937 0

      異步復(fù)位異步釋放會(huì)有什么問題？FPGA異步復(fù)位為什么要同步釋放呢？

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      一般來說，復(fù)位信號(hào)有效后會(huì)保持比較長(zhǎng)一段時(shí)間，確保 register 被復(fù)位完成。但是復(fù)位信號(hào)釋放時(shí)，因?yàn)槠浜蜁r(shí)鐘是異步的關(guān)系，我們不知道它會(huì)在什么時(shí)刻被釋放。

      2024-01-24 標(biāo)簽：FPGA設(shè)計(jì)狀態(tài)機(jī)FDR 1674 0

      淺析FPGA的調(diào)試-內(nèi)嵌邏輯分析儀(SignalTap)原理及實(shí)例

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      對(duì)于FPGA調(diào)試，主要以Intel FPGA為例，在win10 Quartus ii 17.0環(huán)境下進(jìn)行仿真和調(diào)試，開發(fā)板類型EP4CE15F17。

      2024-01-12 標(biāo)簽：FPGA設(shè)計(jì)寄存器狀態(tài)機(jī) 2389 0

      跨時(shí)鐘域的解決方案

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      在很久之前便陸續(xù)談過亞穩(wěn)態(tài)，F(xiàn)IFO，復(fù)位的設(shè)計(jì)。本次亦安做一個(gè)簡(jiǎn)單的總結(jié)，從宏觀上給大家展示跨時(shí)鐘域的解決方案。

      2024-01-08 標(biāo)簽：FPGA設(shè)計(jì)fifoCDC 864 0

      怎樣減少路徑上的LUT個(gè)數(shù)使速度更快呢？

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      對(duì)FPGA設(shè)計(jì)而言如果想速度更快則應(yīng)當(dāng)努力減少路徑上LUT的個(gè)數(shù)，而不是邏輯級(jí)數(shù)。

      2023-12-27 標(biāo)簽：FPGA設(shè)計(jì)LUT 644 0

      FPGA設(shè)計(jì)技巧—多時(shí)鐘域和異步信號(hào)處理解決方案

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      有一個(gè)有趣的現(xiàn)象，眾多數(shù)字設(shè)計(jì)特別是與FPGA設(shè)計(jì)相關(guān)的教科書都特別強(qiáng)調(diào)整個(gè)設(shè)計(jì)最好采用唯一的時(shí)鐘域。

      2023-12-22 標(biāo)簽：FPGA設(shè)計(jì)信號(hào)處理同步器 1445 0

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      隨著尖端工藝的代工成本和現(xiàn)代片上系統(tǒng)（system-on-a-chip，SoC）平臺(tái)設(shè)計(jì)復(fù)雜性的不斷提高，曾經(jīng)局限于一個(gè)國(guó)家甚至一家公司的IC供應(yīng)鏈已經(jīng)...

      2023-11-20 標(biāo)簽：處理器FPGA設(shè)計(jì)場(chǎng)效應(yīng)晶體管 1390 0

      如何設(shè)計(jì)一個(gè)參數(shù)化的數(shù)據(jù)選擇器

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      在FPGA設(shè)計(jì)中，大部分情況下我們都得使用到數(shù)據(jù)選擇器。并且為了設(shè)計(jì)參數(shù)化，可調(diào)，通常情況下我們需要一個(gè)參數(shù)可調(diào)的數(shù)據(jù)選擇器，比如M選1，M是可調(diào)的參數(shù)。

      2023-11-20 標(biāo)簽：FPGA設(shè)計(jì)Verilog數(shù)據(jù)選擇器 1105 0

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      blue-ethernet項(xiàng)目使用Bluespec SystemVerilog(BSV)硬件描述語言實(shí)現(xiàn)了一系列在FPGA上加速網(wǎng)絡(luò)數(shù)據(jù)包處理的硬件模塊。

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      2023-10-18 標(biāo)簽：驅(qū)動(dòng)器FPGA設(shè)計(jì)接收器 891 0

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      2023-10-08 標(biāo)簽：電源設(shè)計(jì)FPGA設(shè)計(jì)PDM 1827 0

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        面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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      st Murata Panasonic Altera Bourns 矽力杰 Samtec 揚(yáng)興科技
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