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fpga設(shè)計(jì)

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

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fpga設(shè)計(jì)技術(shù)

Xilinx FPGA AXI4總線（二）用實(shí)例介紹5個(gè)讀寫通道

AXI4協(xié)議是一個(gè)點(diǎn)對點(diǎn)的主從接口協(xié)議，數(shù)據(jù)可以同時(shí)在主機(jī)（Master）和從機(jī)（Slave）之間**雙向** **傳輸** ，且數(shù)據(jù)傳輸大小可以不同。

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)FIFO存儲 BRAM 3383 0

Xilinx FPGA AXI4總線（一）介紹【AXI4】【AXI4-Lite】【AXI-Stream】

從 FPGA 應(yīng)用角度看看 AMBA 總線中的 AXI4 總線。

2023-06-21 標(biāo)簽：控制器 FPGA設(shè)計(jì)DDR 2239 0

FPGA仿真必備—Matlab生成.mif/.txt/.coe文件

.mif 和 .coe 是 FPGA 設(shè)計(jì)中常用的存儲文件，用于 ROM、RAM 等存儲器數(shù)據(jù)的加載，常見的還用在 DDS 信號發(fā)生器和 FIR 濾波器...

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)存儲器 DDS 5475 0

CDC跨時(shí)鐘域處理及相應(yīng)的時(shí)序約束

CDC（Clock Domain Conversion）跨時(shí)鐘域分單bit和多bit傳輸

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)RAM CDC 1757 0

如何正確使用in_system_ibert呢？

對應(yīng)的IP端口處也會出現(xiàn)相應(yīng)的端口，例如上圖選擇了2個(gè)Quad，也就是8個(gè)通道的串行收發(fā)器，那么對應(yīng)的drp接口就有8個(gè)。

2023-06-21 標(biāo)簽：收發(fā)器 FPGA設(shè)計(jì)串行收發(fā)器 1090 0

講解幾點(diǎn)關(guān)于FIFO IP核使用時(shí)的注意事項(xiàng)

FIFO？還是FIFO IP核？這也需要寫總結(jié)嗎？太容易了吧。如果我是一個(gè)正在處于面試找工作中的年輕人，肯定關(guān)注的是如何手撕FIFO，這也是當(dāng)時(shí)校招時(shí)候...

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)寄存器 RAM 1433 0

Xilinx的高質(zhì)量時(shí)鐘輸出ODDR原語

在SDR接口中，ODDR轉(zhuǎn)發(fā)時(shí)鐘（仍在時(shí)鐘樹內(nèi)），輸出端要直連到輸出port，不可加邏輯，連接方式：輸出時(shí)鐘連接ODDR的C引腳，D1固定值1&apos...

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)SDR RTL 1504 0

ZC706評估板IBERT誤碼率測試和眼圖掃描

IBERT（Integrated Bit ErrorRatio Tester，集成誤比特率測試工具），是Xilinx提供用于調(diào)試FPGA高速串行接口比特...

2023-06-21 標(biāo)簽：收發(fā)器 FPGA設(shè)計(jì)寄存器 3811 0

關(guān)于行為仿真的一點(diǎn)觀點(diǎn)

仿真是為了仿真，所以不要設(shè)置極限情況，例如在時(shí)鐘上升沿通過阻塞賦值給數(shù)據(jù)，應(yīng)該避免這種情況；

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)仿真器 Vivado 481 0

FPGA設(shè)計(jì)心得之Aurora IP核例子簡析與仿真

FLow Control 暫時(shí)選擇為None。（有必要后面專門研究，暫時(shí)最主要的還是弄懂用戶接口信號的用法?。?/p>

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)移位寄存器狀態(tài)機(jī) 1650 0

你真的會Xilinx FPGA的復(fù)位嗎？

對于復(fù)位信號的處理，為了方便我們習(xí)慣上采用全局復(fù)位，博主在很長一段時(shí)間內(nèi)都是將復(fù)位信號作為一個(gè)I/O口，通過撥碼開關(guān)硬件復(fù)位。

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)觸發(fā)器狀態(tài)機(jī) 1162 0

不得不讀的Xilinx FPGA復(fù)位策略

盡量少使用復(fù)位，特別是少用全局復(fù)位，能不用復(fù)位就不用，一定要用復(fù)位的使用局部復(fù)位；

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)微處理器觸發(fā)器 2517 0

乘法器的Verilog HDL實(shí)現(xiàn)方案

兩個(gè)N位二進(jìn)制數(shù)x、y的乘積用簡單的方法計(jì)算就是利用移位操作來實(shí)現(xiàn)。

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)HDL 乘法器 1139 0

怎么通過搗鼓FPGA板把數(shù)碼管給點(diǎn)亮并顯示有效信息？

今天我們?nèi)蝿?wù)是通過小腳丫板載的兩個(gè)數(shù)碼管來顯示字符，所以首先我們要了解一下數(shù)碼管的基本工作原理，接下來再研究怎么通過搗鼓小腳丫把數(shù)碼管給點(diǎn)亮，并且顯示出...

2023-06-20 標(biāo)簽：FPGA設(shè)計(jì)led燈數(shù)碼管 1166 0

通過小腳丫FPGA核心開發(fā)板來進(jìn)行門電路的設(shè)計(jì)

在數(shù)字電路中，門電路是最基本的構(gòu)成單位，可以說，任何復(fù)雜的數(shù)字電路系統(tǒng)都可以通過我們耳熟能詳?shù)呐c門，非門，或門，與非門，異或門等等組合實(shí)現(xiàn)。

2023-06-20 標(biāo)簽：FPGA設(shè)計(jì)led燈 MOS管 1218 0

簡易FM信號解調(diào)的FPGA實(shí)現(xiàn)過程講解

FM解調(diào)需要去掉載波得到基帶的信號，考慮到FM的特殊性，使用參考資料1中的小角度近似解調(diào)算法

2023-06-20 標(biāo)簽：濾波器 FPGA設(shè)計(jì)正弦波 4284 0

介紹FPGA在線調(diào)試的一大利器—VIO

之前的文章介紹了FPGA在線調(diào)試的方法，包括選定抓取信號，防止信號被優(yōu)化的方法等等。

2023-06-20 標(biāo)簽：FPGA設(shè)計(jì)DDS 觸發(fā)器 6819 0

FPGA純verilog編解碼SDI實(shí)現(xiàn)流程

一是使用專用編解碼芯片，比如典型的接收器GS2971，發(fā)送器GS2972，優(yōu)點(diǎn)是簡單，比如GS2971接收器直接將SDI解碼為并行的YCRCB，GS29...

2023-06-19 標(biāo)簽：FPGA設(shè)計(jì)DDR3 接收器 1839 0

FPGA在線調(diào)試的方法簡單總結(jié)

Xilinx被AMD收購的事情把我震出來了，看了看上上一篇文章講了下仿真的文件操作，這篇隔了很久遠(yuǎn)，不知道該從何講起，就說說FPGA的在線調(diào)試的一些簡單...

2023-06-19 標(biāo)簽：FPGA設(shè)計(jì)RTL AXI總線 1990 0

多片F(xiàn)PGA原型驗(yàn)證的限制因素有哪些？

當(dāng)SoC系統(tǒng)的規(guī)模很大的時(shí)候，單片F(xiàn)PGA驗(yàn)證平臺已經(jīng)無法容納這么多容量，我們將采取將SoC設(shè)計(jì)劃分為多個(gè)FPGA的映射。

2023-06-19 標(biāo)簽：FPGA設(shè)計(jì)連接器 TDM 699 0

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Protues

Protues

+關(guān)注

Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

+關(guān)注

為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

AD10

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識別

識別

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FPGA開發(fā)板

FPGA開發(fā)板

+關(guān)注

FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

+關(guān)注

Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
PCB封裝庫

PCB封裝庫

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語音交互

語音交互

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AD09

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PDN

PDN

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QuickPcb

QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
VHDL代碼

VHDL代碼

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Protel 99 se

Protel 99 se

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powerlink

powerlink

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candence

candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
驅(qū)動電流

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時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
FPGA教程

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號的變化量。
紅外觸摸屏

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