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      標簽　>　serdes

      serdes

      serdes

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      SERDES是（串行器）/（解串器）的簡稱。它是一種主流的時分多路復用（TDM）、點對點（P2P）的串行通信技術。

      文章：100個 瀏覽：34853次 帖子：49個

      serdes技術

      詳細討論SERDES用到的各種關鍵技術

      詳細討論SERDES用到的各種關鍵技術

      隨著大數據的興起以及信息技術的快速發展，數據傳輸對總線帶寬的要求越來越高，并行傳輸技術的發展受到了時序同步困難、信號偏移嚴重，抗干擾能力弱以及設計復雜度...

      2023-05-10 標簽：收發器濾波器FPGA設計 1657 0

      FPGA技術：SerDes是怎么設計的

      利用源同步接口，數據的有效窗口可以提高很多。通常頻率都在1GHz以下。在實際應用中可以見到如SPI4.2接口的時鐘可以高達DDR 700MHz x 16...

      2023-03-28 標簽：fpga接口adc 1392 0

      深度解讀SerDes（Serializer-Deserializer）3

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      對于高速SerDes的仿真需要借助統計分析 (statistical analysis) 的方法。統計分析的方法把發送端-信道-接收端的連接近視為線性系...

      2023-03-16 標簽：仿真SerDesFFE 1156 0

      深度解讀SerDes（Serializer-Deserializer）1

      深度解讀SerDes（Serializer-Deserializer）1

      FPGA發展到今天，SerDes（Serializer-Deserializer）基本上是器件的標配了。從PCI發展到PCI-E，從ATA發展到SATA...

      2023-03-16 標簽：fpgaadcSerDes 2925 0

      淺析高端SerDes集成到FPGA中的挑戰

      在過去的幾十年里，電子通信行業一直是 FPGA 市場增長背后的重要推動力，并將繼續保持下去。

      2023-02-22 標簽：fpga解串器SerDes 1214 0

      高端SerDes集成到FPGA中的挑戰

      在過去的幾十年里，電子通信行業一直是 FPGA 市場增長背后的重要推動力，并將繼續保持下去。這背后的一個主要原因是 FPGA 中內置了許多不同的高速接口...

      2023-02-22 標簽：dspfpga臺積電 1517 0

      幫助你了解SerDes！

      此外，這些并行數據線中的每一條都不僅僅是布局和布線人員所關心的問題。緊密間隔的電線或 PCB 跡線（如圖 2 所示）容易受到串擾的影響，尤其是數字信號的...

      2023-02-20 標簽：串行通信SerDes 1466 0

      SerDes是什么？SerDes功能和特性概述

      SerDes 是空間到時間到空間的轉換。并行數據同時傳輸但占用不同的物理互連，串行數據共享相同的物理空間但占用不同的時間時刻

      2023-01-31 標簽：微控制器pcb電磁干擾 4860 0

      深度解析xilinx 高速收發器Serdes

      由于傳輸線的時延不一致和抖動存在，接收端不能正確的采樣數據，對不準眼圖中點。 然后就想到了從數據里面恢復出時鐘去采樣數據，即CDR

      2023-01-11 標簽：收發器Xilinx差分信號 1979 0

      SerDes的基本結構

      FPGA發展到今天，SerDes(Serializer-Deserializer)基本上是標配了。

      2022-10-31 標簽：接口觸發器SerDes 1851 0

      常用的千兆網接口介紹

      本篇文章主要是對前兩種常用的千兆網接口的介紹，以直觀的方式對比這兩種接口在引腳方面的不同，比較適合幫助初學者建立一個初步的印象，能夠快速的了解RGMII...

      2022-10-08 標簽：接口SerDes千兆網 1.2萬 0

      使用ISERDES接收高速串行數據

      使用ISERDES接收高速串行數據

      但是，在內部處理信號時，數據信號往往是多bit信號，而傳輸過程中需要用到單bit串行傳輸技術，所以，中間需要有一個轉換器，實現并串轉換，這就需要用到SE...

      2022-08-20 標簽：fpga轉換器DDR 4841 0

      SERDES的引腳數量和通道優勢

      SERDES最明顯的優勢是具備更少的引腳數量和線纜/通道數量。對于早期的SERDES，這意味著數據可以通過同軸電纜或光纖發送。

      2022-07-22 標簽：數據引腳SerDes 3331 0

      等長對我們信號質量有什么影響？

      等長對我們信號質量有什么影響？

      SERDES信號都是由差分傳輸的，也就是說，兩根信號線同時傳輸兩個大小相等，方向相反的信號，接收端接收到的信號由兩線相減得來。

      2021-04-13 標簽：波形SerDes等長 3803 0

      串行系列：并行信號變成串行信號過程

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      做過layout的朋友一定會有一種這樣的感覺，串行通道恐怕是最容易設計的部分了。通道就一對差分線，芯片端串行部分信號pin的密度都相對低，出線也十分簡單...

      2021-05-02 標簽：Layout并行信號SerDes 4648 0

      基于LS1046A&LS1028A的飛凌嵌入式平臺的SerDes資源分配解析

      目前我們已經發布了NXP的QorIQLS架構系列的幾款平臺，包含LS1046A、LS1043A、LS1028A、LS1012A。這幾款平臺都原生支持網口...

      2020-10-29 標簽：嵌入式NXPSATA 2104 0

      GMII、SGMII和SerDes的差異總結

      GMII、SGMII和SerDes的差異總結

      GMII、SGMII和SerDes的區別和聯系？ GMII和SGMII區別，上一篇已經介紹了，這一篇重點介紹SGMII和SerDes區別。 GMII和S...

      2020-10-09 標簽：MacSerDesPCI-e總線 3.2萬 0

      高速SerDes應用的PCB設計要點

      速度最快的SerDes單一通道的帶寬已達112Gbps，支持PAM4編碼。如此高的速率，使得在整個系統中實現高速信號布線會面臨許多許多設計難題。

      2020-03-22 標簽：PCB設計SerDes 4189 0

      如何利用SerDes降低高帶寬數據接口總線的寬度

      如何利用SerDes降低高帶寬數據接口總線的寬度

      早期的SerDes產品，如圖1所示的Channel Link I器件，通過使用一個單獨的時鐘線把并行數據總線（寬度達48位）串行到多通道LVDS總線上。...

      2019-10-10 標簽：高帶寬SerDes數據總線 2529 0

      回顧接口技術發展歷史

      當然從總數據帶寬的角度看，比如64bit DDR3-1600的最大數據帶寬也超過了100Gbps（64*1.6Gbps）。也能提供不俗的總帶寬表現。其實...

      2018-08-15 標簽：接口技術SerDes 1.4萬 0

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