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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數字系統硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數字邏輯系統所完成的邏輯功能。

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2019-09-27 標簽：fpga 監控 verilog 1752 0

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基于Verilog實現2ASK的調制

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高質量Verilog代碼有什么特點

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在接觸Verilog 語法參考手冊的時候，我們發現其提供了一組非常豐富的功能來描述硬件。所以大家往往會疑惑那些Verilog語句是可綜合的，那些是只能用...

2019-04-20 標簽：fpga 存儲器 verilog 4541 0

詳解Verilog的一些基本要素

前面已經說到，模塊名的定義要符合標識符的定義，那么什么是標識符呢？它的語法是什么呢？

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2019-01-01 標簽：FPGA Verilog 編程 8433 1

使用verilogHDL實現乘法器

本文在設計實現乘法器時，采用了4-2和5-2混合壓縮器對部分積進行壓縮，減少了乘法器的延時和資源占用率；經XilinxISE和QuartusII兩種集...

2018-12-19 標簽：Verilog EDA技術 1.1萬 0

如何利用verilog驗證二分法查找的設計代碼

下面是產生輸出文件的過程，這里我們設置輸出結果的格式是fsdb，當然我們也可以設置成vcd的格式。fsdb的文件size比較小，而且利用verdi的波形...

2018-11-26 標簽：電路服務器 verilog 5679 0

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圖5，CMOS傳輸門，雙向傳輸，當C=0，~C=Vdd，兩個MOS管都截止，輸入和輸出之間呈現高阻態，當C=Vdd，~C=0，如果0 <= Vi <= ...

2018-11-12 標簽：CMOS 反相器 Verilog 1.4萬 0

Verilog和VHDL之間如何互轉

當然階段四純屬個人的對未來的推測，但是，近年來，FPGA也高速發展，明顯有當年匯編語言開發到C高級語言開發的趨勢，我們是不是應該不局限于只學習FPG...

2018-11-12 標簽：Verilog C語言 VHDL 2.5萬 0

FPGA中的testbench介紹

跟大家解釋一點，所有testbench本質上都是串行執行，因為在CPU環境下，沒有可靠并行執行的能力。所有并行的語句，比如兩個always模塊，fork...

2018-10-10 標簽：FPGA verilog 9585 0

如何把二進制轉換為格雷碼？格雷碼是如何判斷讀空寫滿呢？

在傳遞讀寫時鐘域的指針使用格雷碼來傳遞，如何把二進制轉換為格雷碼，格雷碼是如何判斷讀空寫滿呢？

2018-09-15 標簽：二進制 verilog 格雷碼 8292 0

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2018-09-15 標簽：Verilog Case IF 1.0萬 0

FPGA學習verilog代碼的經驗總結

既然HDL設計是并行的，那么就只能各個擊破了。我的習慣是先抓幾個重要端口，比如時鐘(CLK)、復位(RESET)等出現頻率比較高的端口，把它先弄清楚...

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2018-09-15 標簽：verilog rtl 3782 0

組合邏輯概述

根據狄摩根定律第二條，就可以將積之和布爾表達式轉化成和之積形式；根據狄摩根定律第一條，就可以將和之積布爾表達式轉化成積之和形式。

2018-09-10 標簽：邏輯電路 Verilog 7996 0

數字電路里面有什么元素需要被描述?

組合邏輯電路：可以利用 assign 或者 always @(*) 語句描述。一般復雜的組合邏輯電路利用 always @(*)語句塊描述。如上加法...

2018-09-07 標簽：邏輯電路 Verilog 數字電路 4672 0

采用FPGA和單片機結合的等精度原理的測量頻率實現

傳統測量頻率的方法主要有直接測量法、分頻測量法、測周法等，這些方法往往只適用于測量一段頻率，當被測信號的頻率發生變化時，測量的精度就會下降。

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