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電子發(fā)燒友網(wǎng)>RF/無線>基于DSP+DDS結(jié)構(gòu)的可編程調(diào)制器的硬件平臺(tái)設(shè)計(jì)

基于DSP+DDS結(jié)構(gòu)的可編程調(diào)制器的硬件平臺(tái)設(shè)計(jì)

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各位大神 求led可編程風(fēng)火輪電路圖(不可編程葉可以) 急...

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2014-10-08 16:25:13

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2021-04-23 07:04:59

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新人請(qǐng)問:FPGA即現(xiàn)場(chǎng)可編程門陣列,其中的“現(xiàn)場(chǎng)”是什么意思?指的是什么?
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2018-08-18 06:34:59

請(qǐng)問FM調(diào)制器的FPGA實(shí)現(xiàn)

求助FM調(diào)制器的FPGA實(shí)現(xiàn),對(duì)FPGA這些完全不了解,在網(wǎng)上看可以用DDS技術(shù)實(shí)現(xiàn)FM的數(shù)字調(diào)制,就在書上按照步驟先做了產(chǎn)生正弦波分頻模塊尋址模塊數(shù)據(jù)存儲(chǔ)模塊,但編譯不能通過,也不知道該怎樣進(jìn)行頻率調(diào)制,請(qǐng)問該怎樣實(shí)現(xiàn)頻率的調(diào)制,請(qǐng)問有人寫過頻率調(diào)制的verilog代碼嗎,急求,謝謝
2019-03-16 11:43:26

請(qǐng)問怎樣去設(shè)計(jì)數(shù)字化可編程頻率合成器?

DDS9850的原理是什么?怎樣去設(shè)計(jì)數(shù)字化可編程頻率合成器?DDS與使用PLL技術(shù)實(shí)現(xiàn)的頻率合成器相比,有哪些優(yōu)勢(shì)?
2021-04-20 07:30:07

請(qǐng)問矢量調(diào)制器和IQ調(diào)制器有什么區(qū)別

矢量調(diào)制器和IQ調(diào)制器有什么區(qū)別
2018-08-22 10:32:18

可編程控制器(PLC)

可編程控制器(PLC) PPT課件 11.1 可編程控制器的結(jié)構(gòu)和工作原理11.2 可編程控制器的程序編制11.3 可編程控制器應(yīng)用舉例本章要求:1. 了解可編程控制器的結(jié)構(gòu)和工作原
2008-12-04 14:23:220

DSP實(shí)現(xiàn)CPLD多方案現(xiàn)場(chǎng)可編程配置

結(jié)合繼電保護(hù)測(cè)試裝置的研制體會(huì),介紹基于DSP 的CPLD 多方案現(xiàn)場(chǎng)可編程配置方法,給出硬件的配置連接、CPLD 配置數(shù)據(jù)的獲取與存儲(chǔ)方法和CPLD 在DSP 控制下的被動(dòng)串行配置過程。設(shè)
2009-04-15 08:50:5529

DSP實(shí)現(xiàn)CPLD多方案現(xiàn)場(chǎng)可編程配置

結(jié)合繼電保護(hù)測(cè)試裝置的研制體會(huì),介紹基于DSP 的CPLD 多方案現(xiàn)場(chǎng)可編程配置方法,給出硬件的配置連接、CPLD 配置數(shù)據(jù)的獲取與存儲(chǔ)方法和CPLD 在DSP 控制下的被動(dòng)串行配置過程。設(shè)
2009-05-18 14:33:2416

一種基于DSP Builder 的軟件無線電調(diào)制器的設(shè)計(jì)與實(shí)

一種基于DSP Builder 的軟件無線電調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)::針對(duì)基于FPGA 的DSP 技術(shù),本文提出了一種基于DSP Builder 的軟件無線電調(diào)制器的設(shè)計(jì)方法,在DDS 的理論基礎(chǔ)上,采用DSP Builder 軟
2009-12-14 11:08:0334

DSP無線電調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)

DSP無線電調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn) 摘要:針對(duì)基于FPGA 的DSP 技術(shù),本文提出了一種基于DSP Builder 的軟件無線電調(diào)制器的設(shè)計(jì)方法,在DDS 的理論基礎(chǔ)上,采用DSP Builder
2010-04-01 15:48:4616

一種通用的可編程雙模分頻器

提出了一種通用的可編程雙模分頻器,電路主要由3 部分組成: 9/8 預(yù)分頻器,8 位可編程計(jì)數(shù)器和ΣΔ調(diào)制器構(gòu)成。通過打開或者關(guān)斷ΣΔ 調(diào)制器的輸出來實(shí)現(xiàn)分?jǐn)?shù)和整數(shù)分頻兩種工作
2010-04-23 08:39:3530

基于AD9851型DDS的數(shù)字調(diào)制系統(tǒng)設(shè)計(jì)

 設(shè)計(jì)實(shí)現(xiàn)了以單片機(jī)AT89S51為控制核心,以現(xiàn)場(chǎng)可編程門陣列(Field Porgrammable Gate Array,簡稱FPGA)為數(shù)據(jù)處理核心,采用直接數(shù)字頻率合成(DDS)技術(shù)構(gòu)成的數(shù)字調(diào)制系統(tǒng)。各
2010-12-20 17:29:57105

現(xiàn)場(chǎng)可編程門陣列的結(jié)構(gòu)與設(shè)計(jì)

現(xiàn)場(chǎng)可編程門陣列的結(jié)構(gòu)與設(shè)計(jì)   摘要:現(xiàn)場(chǎng)可編程門陣列(FPGA——Field Programmable Gate Array)是上世紀(jì)80年代末發(fā)展起
2009-07-07 10:59:171349

DSP器件的現(xiàn)場(chǎng)可編程技術(shù)

DSP器件的現(xiàn)場(chǎng)可編程技術(shù) DSP問世以來,以其強(qiáng)大的功能、合理的價(jià)格已經(jīng)被設(shè)計(jì)者廣泛應(yīng)用。但不同于FPGA器件的是,DSP并不是為現(xiàn)場(chǎng)可編程而開發(fā)的,因此,在嵌入了DSP
2010-01-07 10:11:52807

賽靈思推出DTV可編程平臺(tái)

賽靈思推出DTV可編程平臺(tái) 賽靈思公司日前在美國國際消費(fèi)電子展 (CES) 上宣布推出首款為開發(fā)最先進(jìn)數(shù)字電視 (DTV) 解決方案而優(yōu)化的可編程平臺(tái)。該款賽靈思消費(fèi)DTV目
2010-01-09 10:38:42742

可編程振蕩器,什么是可編程振蕩器

可編程振蕩器,什么是可編程振蕩器 可編程振蕩器是20世紀(jì)90年代早期為克服常規(guī)振蕩器制造時(shí)間長的缺點(diǎn)而推出的。如圖1所示,任意頻率的常規(guī)
2010-03-22 14:40:142426

可編程SoC(SoPC),什么是可編程SoC(SoPC)

可編程SoC(SoPC),什么是可編程SoC(SoPC) SOPC ( System on a Programmable Chip,片上可編程系統(tǒng))是以PLD(可編程邏輯器件)取代ASIC(專用集成電路),更
2010-03-26 17:01:352336

Quicklogic ArcticLink可編程連接平臺(tái)設(shè)計(jì)

Quicklogic ArcticLink可編程連接平臺(tái)設(shè)計(jì)方案 ArcticLink可編程連接解決方案平臺(tái)采用0.18um六層金屬CMOS工藝制造,內(nèi)核電壓為1.8V,I/O電壓可設(shè)定為1.8V,2.5V和3.3
2010-04-22 18:12:38815

可編程陣列邏輯(Programmable Array Log

可編程陣列邏輯(Programmable Array Logic) 可編程陣列邏輯(PAL)是一種與項(xiàng)可編程、或項(xiàng)固定結(jié)構(gòu)可編程結(jié)構(gòu),為能方便實(shí)現(xiàn)各種邏輯功能,其輸出結(jié)構(gòu)通常
2010-09-18 09:13:111788

基于AD9954的多模式調(diào)制器的設(shè)計(jì)

AD9954是采用先進(jìn)的DDS技術(shù)生產(chǎn)的高集成度頻率合成器,通過對(duì)幅度、頻率、相位的編程來生成不同的信號(hào)。本方案以AD9954為核心設(shè)計(jì)平臺(tái),通過FPGA和單片機(jī)的控制,設(shè)計(jì)了一種功能齊全、性能優(yōu)良的調(diào)制器。對(duì)所產(chǎn)生的信號(hào)作了理論分析,并闡述了該調(diào)制器的系統(tǒng)
2011-02-12 15:05:3878

可編程DSP芯片的基本結(jié)構(gòu)和特征

可編程DSP芯片是一種具有特殊結(jié)構(gòu)的微處理器,為了達(dá)到快速進(jìn)行數(shù)字信號(hào)處理的目的,DSP芯片一般都具有程序和數(shù)據(jù)分開的總線結(jié)構(gòu)、流水線操作功能、單周期完成乘法的硬件乘法器以及一套適合數(shù)字信號(hào)處理的指令集。本章將首先介紹DSP芯片的基本結(jié)構(gòu),然后介紹
2011-03-01 16:30:55685

基于現(xiàn)代DSP技術(shù)的QPSK調(diào)制器的設(shè)計(jì)

為了提高DSP系統(tǒng)的開發(fā)效率,引入了現(xiàn)代DSP技術(shù),并由此設(shè)計(jì)了QPSK調(diào)制器。依據(jù)QPSK調(diào)制的基本原理,利用MATLAB/Simulink DSP Builder和Quartusll搭建模型
2011-05-23 10:40:191954

可編程硅蕩器SITIME

可編程有源晶振的制造方式及其優(yōu)點(diǎn): 可編程有源晶振是由兩顆芯片;一為全硅MEMS諧振器,一為具有溫補(bǔ)功能之啟動(dòng)電路鎖相環(huán)CMOS芯片;利用標(biāo)準(zhǔn)半導(dǎo)體芯片MCM封裝方式完成。 可編程
2011-06-08 18:04:421689

DDS實(shí)現(xiàn)MSK信號(hào)調(diào)制

討論一種基于DSP系統(tǒng),利用FPGA設(shè)計(jì)接口通過DDS芯片產(chǎn)生MSK調(diào)制的方法,使用該方案的硬件電路簡潔且易于實(shí)現(xiàn)調(diào)制器的小型化。
2012-02-09 15:14:4611

基于DDS可編程的波形發(fā)生器

給予DDS可編程的波形發(fā)生器,對(duì)三個(gè)不同頻段的波形信號(hào)進(jìn)行分析
2015-11-02 17:22:443

高效FSK_PSK調(diào)制器利用多通道DDS實(shí)現(xiàn)零交越切換介紹

高效FSKPSK調(diào)制器利用多通道DDS實(shí)現(xiàn)零交越切換
2016-01-07 14:57:260

DDS多波信號(hào)發(fā)生器的實(shí)現(xiàn)

詳細(xì)介紹了直接數(shù)字頻率合成器(DDS)的工作原理、基本結(jié)構(gòu)。在參考DDS 相關(guān)文獻(xiàn)的基礎(chǔ)上,提出了符合結(jié)構(gòu)DDS 設(shè)計(jì)方案,利用DDS 技術(shù)設(shè)計(jì)了一種高頻率精度的多波形信號(hào)發(fā)生器,此設(shè)計(jì)基于可編程邏輯器件FPGA,采用Max+PlusⅡ開發(fā)平臺(tái),由Verilog_HDL 編程實(shí)現(xiàn)。
2016-11-22 14:35:130

可編程邏輯器件FPGA/CPLD結(jié)構(gòu)與應(yīng)用

可編程邏輯器件FPGA/CPLD結(jié)構(gòu)與應(yīng)用
2016-12-11 23:38:390

基于DSP的調(diào)頻調(diào)制器設(shè)計(jì)

基于DSP的調(diào)頻調(diào)制器設(shè)計(jì)
2017-10-19 15:07:352

基于DSP處理器的數(shù)字OQPSK調(diào)制器實(shí)現(xiàn)方案

電路來完成,存在電路復(fù)雜、體積大和功耗高等缺點(diǎn)。隨著高速DSP處理器的應(yīng)用,本文提出了一種基于DSP處理器的數(shù)字OQPSK調(diào)制器實(shí)現(xiàn)方案,讓OQPSK調(diào)制器的大部分功能由DSP處理器執(zhí)行相應(yīng)的算法實(shí)現(xiàn),此方案省去了大量的硬件電路,具有體積小、功耗低、
2017-10-25 10:46:300

DSP調(diào)頻調(diào)制器設(shè)計(jì)方案解析

無線通信功能的一種開放式體系結(jié)構(gòu)。本文基于這一思想,首先構(gòu)造一個(gè)DSP與PC機(jī)接口的硬件平臺(tái),繼而在該平臺(tái)上實(shí)現(xiàn)較為簡單的FM調(diào)制器。該系統(tǒng)的實(shí)現(xiàn)為以后研究基于軟件無線電其他制式的調(diào)制解調(diào)器提供了基本平臺(tái)。 1 系統(tǒng)原理 本
2017-11-04 10:30:133

實(shí)現(xiàn)重要分析與硬件加速的可編程Xilinx zynq-7000平臺(tái)推薦

Xilinx Zynq-7000 全可編程 SoC (AP SoC) 系列集成 ARM處理器的軟件可編程性與 FPGA 的硬件可編程性,不僅可實(shí)現(xiàn)重要分析與硬件加速,同時(shí)還在單個(gè)器件上高度集成 CPU、DSP、ASSP 以及混合信號(hào)功能。
2017-11-07 14:37:527144

『 RJIBI 』- FACE-Z7 可編程實(shí)驗(yàn)平臺(tái)

引擎平臺(tái)。其旨在通過借助FPGA與ARM靈活的軟硬件可編程能力、并行算法實(shí)現(xiàn)以及動(dòng)態(tài)可重構(gòu)的特性搭配外圍大容量DDR3/DDR4存儲(chǔ)以及PCIe、QSFP、SATA等高速接口,助力高校和科研院所相關(guān)
2020-05-19 09:51:281740

采用5管單元的SRAM結(jié)構(gòu)實(shí)現(xiàn)CPLD可編程電路的設(shè)計(jì)

顯然,設(shè)計(jì)基于SRAM編程技術(shù)的CPLD可以很好解決上述應(yīng)用問題。CPLD的設(shè)計(jì)和實(shí)現(xiàn)的關(guān)鍵問題是核心可編程電路結(jié)構(gòu)的實(shí)現(xiàn)。因此,本文主要探討針對(duì)CPLD的核心可編程結(jié)構(gòu),如何設(shè)計(jì)具有相似功能且基于SRAM編程技術(shù)的電路結(jié)構(gòu),從而更好滿足動(dòng)態(tài)重構(gòu)系統(tǒng)中實(shí)現(xiàn)復(fù)雜狀態(tài)機(jī)和譯碼電路的應(yīng)用。
2020-04-25 10:21:001686

超全使用串口對(duì)DSP進(jìn)行應(yīng)用可編程的方法

本文介紹了一種通過串口對(duì)DSP進(jìn)行應(yīng)用可編程的方法,該方法簡單易操作,文中給出了具體的實(shí)現(xiàn)方法。
2021-04-02 16:13:382750

AD9853:可編程數(shù)字QPSK/16-QAM調(diào)制器過時(shí)數(shù)據(jù)表

AD9853:可編程數(shù)字QPSK/16-QAM調(diào)制器過時(shí)數(shù)據(jù)表
2021-04-15 11:19:028

AD7008:CMOS DDS調(diào)制器過時(shí)數(shù)據(jù)表

AD7008:CMOS DDS調(diào)制器過時(shí)數(shù)據(jù)表
2021-05-17 18:03:330

可編程邏輯器件的結(jié)構(gòu)

常見的可編程邏輯器件分為FPGA、EPLD(CPLD)。下面簡單介紹兩類器件的結(jié)構(gòu)和區(qū)別。
2023-03-24 14:18:28798

基于現(xiàn)代DSP技術(shù)的QPSK調(diào)制器的設(shè)計(jì)

電子發(fā)燒友網(wǎng)站提供《基于現(xiàn)代DSP技術(shù)的QPSK調(diào)制器的設(shè)計(jì).pdf》資料免費(fèi)下載
2023-10-27 09:28:210

空間光調(diào)制器的原理 空間光調(diào)制器的作用

信息處理等領(lǐng)域有重要的應(yīng)用。 空間光調(diào)制器的工作原理基于光的幅度、相位的空域分布特性。當(dāng)光通過空間光調(diào)制器時(shí),其幅度和相位會(huì)由光在空間上的分布結(jié)構(gòu)所決定,通過調(diào)節(jié)空間光調(diào)制器的控制參數(shù),可以控制光的幅度、相位的
2023-12-20 13:45:01734

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