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Verilog HDL語言簡(jiǎn)介

2010-02-09 08:59不詳 佚名我要評(píng)論（0）我要收藏

Verilog HDL語言簡(jiǎn)介

1．什么是Verilog HDL
Verilog HDL是硬件描述語言的一種，用于數(shù)字電子系統(tǒng)設(shè)計(jì)。它允許設(shè)計(jì)者用它來進(jìn)行各種級(jí)別的邏輯設(shè)計(jì)，可以用它進(jìn)行數(shù)字邏輯系統(tǒng)的仿真驗(yàn)證、時(shí)序分析、邏輯綜合。它是目前應(yīng)用最廣泛的一種硬件描述語言之一。

2．Verilog HDL的歷史
Verilog HDL是在1983年由GDA（GateWay Design Automation）公司的Phil Moorby首創(chuàng)的。Phil Moorby后來成為Verilog-XL的主要設(shè)計(jì)者和Cadence公司（Cadence Design System）的第一個(gè)合伙人。
在1984年～1985年，Moorby設(shè)計(jì)出了第一個(gè)關(guān)于Verilog-XL的仿真器，1986年，他對(duì)Verilog HDL的發(fā)展又做出了另一個(gè)巨大貢獻(xiàn)：即提出了用于快速門級(jí)仿真的XL算法。
隨著Verilog-XL算法的成功，Verilog HDL語言得到迅速發(fā)展。1989年，Cadence公司收購(gòu)了GDA公司，Verilog HDL語言成為Cadence公司的私有財(cái)產(chǎn)。1990年，Cadence公司決定公開Verilog HDL語言，于是成立了OVI（Open Verilog International）組織來負(fù)責(zé)Verilog HDL語言的發(fā)展。

3．Verilog HDL的進(jìn)展
基于Verilog HDL的優(yōu)越性，IEEE于1995年制定了Verilog HDL的IEEE標(biāo)準(zhǔn)，即Verilog HDL1364-1995。其后，又在2001年發(fā)布了Verilog HDL1364-2001標(biāo)準(zhǔn)。
據(jù)有關(guān)文獻(xiàn)報(bào)道，目前在美國(guó)使用Verilog HDL進(jìn)行設(shè)計(jì)的工程師大約有60000人，全美國(guó)有200多所大學(xué)教授用Verilog硬件描述語言的設(shè)計(jì)方法。在我國(guó)臺(tái)灣地區(qū)幾乎所有著名大學(xué)的電子和計(jì)算機(jī)工程系都講授Verilog有關(guān)的課程。

標(biāo)簽：HDL(18)
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(責(zé)任編輯：發(fā)燒友)

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